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zpwsmileBops的软件工具包针对高级DSP架构进行了调整

发布日期:2020-02-13 02:01   来源:未知   阅读:

  加利福尼亚州圣克拉拉(ChipWire) - 一家致力于高性能DSP内核的创业公司Bops Inc.推出了下一代产品本周在DesignCon上生成软件开发工具。 Bopssoftware开发工具包的2.0版本包括C和

  的编译器,可以解决为新架构开发高度调整的代码的问题。总部位于加利福尼亚州帕洛阿尔托的Bops公司的目标是高性能应用,如视频信号处理,3D

  图形,xDSL和无线,销售和营销副总裁Rick Kepple说。例如,调制信号--Kepple称之为“天线操作” - 对于第三代蜂窝基站来说,每秒需要数百亿次操作。为了防止密集的系统过热,每秒每1亿条指令的功耗必须保持在10毫瓦左右。 Kepple表示,执行MPEG编码和解码的数码摄像机的总功耗必须低于600 mW。Bops内核旨在为这些应用程序提供可扩展的性能和低功耗。每个内核每秒将执行32亿次16位操作,时钟频率为200 MHz。该架构支持8位,16位或32位操作数的固定和浮点数学运算。使用32位操作数,性能大约为每秒10亿次浮点运算。

  MIPS处理器内核的松散耦合协处理器。核心由两个元素组成:用于控制和顺序功能的序列处理器(SP),以及用于并行任务的从属处理元件(PE)。虽然它与单个媒体访问控制器(MAC)和算术逻辑单元(ALU)对话,但是单指令,多数据类SP包含三个并行级别:并行数据(通过数据存储器),并行指令(通过VLIW) Kepple说,指令存储器)和并行处理器(通过指令地址单元)。不同版本的Bops核心将SP和PE并联和串联组合在一起 - 实际上是一个矩阵 - 用于各种性能组合。例如,Bops2010包括一个SP和一个1×1矩阵的PE。 Bops2020包括一个SP和两个1x2矩阵的PE; Bops2040包括一个SP和4个4×4矩阵的PE。

  DMA控制器传输,并平衡矩阵中的活动。因此,根据Kepple的说法,在100 MHz时,Bops2040内核将在2.2微秒(213个周期)内执行256点快速傅里叶变换。 Kepple说,TIC6X在同一操作中需要13.3微秒(200 MHz时为2,660个周期)。他说,与C6X相比,Bops2040的芯片尺寸仅为四分之一,功耗仅为四分之一,内存和总线带宽的五分之一。与任何并行处理器一样,编程仍然是个问题。本周推出的新软件开发工具旨在增强可编程性--Kepple称之为DSP标准的“第四个P”(性能,功耗和处理之后)。除了基本的DSP库之外,Bops工具集还包括系统仿真器

  寄存器分配器,以及用于编译器和矢量库的编译器和矢量库。 MATLAB软件世界上只有大约60,000名DSP程序员能够使用汇编语言,相比之下,有600万能够使用C语言工作,Kepple说。任何编程工具的目标都是利用C语言程序员的基础。

  编译器效率最小化程序员调整。 Kepple说,需要进行一定数量的代码调整,以最大限度地减少程序分支的处罚,并平衡并行处理器之间的负载。

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